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全新的Tanner ASIC套包支持完整的模擬/數?；旌霞呻娐罚↖C）的設計、仿真與驗證流程，包括芯片前端電路設計、Spice/VHDL/Verilog/混合信號仿真、芯片版圖設計及面向Foundry工藝規則的版圖驗證等功能。Tanner ASIC套包以Tanner原有的版圖設計工具L-Edit為核心，集成了業界普遍應用的經典工具如ModelSim、Calibre One、Eldo、EZWave等，是Mentor Graphics在模擬/數?；旌闲酒O計領域重點發展的、最具性價比的解決方案！其中大部分環境支持Windows系統，操作界面友好，尤其適合模擬/混合芯片設計公司、物聯網（IoT）行業、高校等用戶學習和使用。

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此外，Mentor Graphics還與主流的Foundry廠合作，定制大量的PDK并取得Foundry廠的認證，從而幫助芯片設計公司降低風險，加快產品的流片及推向市場的速度。

Tanner ASIC的關鍵特性：

- 支持模擬/數?；旌闲酒娜ㄖ屏鞒?，易學易用

- 兼容OpenAccess、LEF/EDF、Libery和SDF等格式

-?支持不同層次模型的聯合仿真，如行為級模型、RTL Block、門級和晶體管Block等

- 支持不同類型HDL語言的聯合仿真和調試，如SystemVerilog、Verilog、Verilog-AMS、Verilog-A和VHDL

- 支持Top-Down層次結構及混合信號的協同仿真

- 支持高速時序分析

-?在FPGA綜合過程中支持DFT參數設置

-?提供主流Foundry廠認證的PDK

-?高效率的芯片版圖布局布線功能，支持任意角度布線與交互式在線DRC布線

-?自帶Calibre環境，提供芯片版圖驗證功能，支持層次設計的DRC檢查與網表提取

-?兼容Windows和Linux系統，設計數據兼容不同系統

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